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时间: 2019-08-13 14:45
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PCB抄板设计:24个小窍门，减少噪音和电磁干扰 随着电子设备灵敏度的提高，设备的抗干扰能力越来越强。因此，PCB设计变得越来越困难。如何提高PCB的抗干扰能力已成为许多工程师关注
PCB抄板设计:24个小窍门，减少噪音和电磁干扰
随着电子设备灵敏度的提高，设备的抗干扰能力越来越强。因此，PCB设计变得越来越困难。如何提高PCB的抗干扰能力已成为许多工程师关注的关键问题之一。本文将介绍如何在PCB设计中降低噪声和电磁干扰。
通过多年的设计总结出以下24条PCB设计中降低噪声和电磁干扰的建议:
使用低速芯片而不是高速芯片。高速芯片用于关键部位。
(2)可采用一系列电阻来降低控制电路沿跳变上下的速度变化率。
(3)尝试为继电器等提供某种形式的阻尼。
(4)使用符合系统要求的最小频率时钟。
(5)时钟发生器尽可能靠近使用时钟的设备。石英晶体振荡器外壳要接地。
(6)用座机圈出时钟区域，尽量使时钟线短。
(7) I/O驱动电路应尽可能靠近印版，使其能尽快离开印版。进入PCB信号要过滤，从信号的高噪声区
还加入滤波，同时采用串联终端电阻法，减少信号反射。
(8) MCD的无用端应连接到高处或地面，或定义为输出端。电源接地端应连接在集成电路上，且不应挂起。
(9)门电路空闲输入端不应暂停。运算放大器的空闲输入端接地，负输入端与输出端连接。
(10) PCB应该使用45折线而不是90折线来减少高频信号的传输和耦合。
(11) PCB按频率和电流开关特性进行划分，噪声元件和非噪声元件应进一步分离。
(12)电源采用单面板和双面板连接，单点接地，电源线和地线尽量粗，经济实惠时采用多层板应使用减少电源。
地球的电容电感。
(13)保持时钟、总线、芯片信号远离I/O线和连接器。
(14)模拟电压输入线和参考电压端应远离数字电路信号线，特别是时钟。
(15)对于A/D类设备，数字部分与模拟部分应统一，不能交叉。
(16)垂直于I/O线的时钟线比平行的I/O线干扰小，时钟元件的引脚远离I/O电缆。
(17)元件销应尽可能短，解耦电容销应尽可能短。
(18)关键线路应尽可能粗，并在两侧增加防护用地。高速铁路应该短而直。
(19)对噪声敏感的线路不应与大电流、高速开关线路平行。
(20)请勿在石英晶体或噪声敏感设备下敷设。
(21)弱信号电路，低频电路周围不形成电流回路。
(22)任何信号都不应形成环路，如不可避免，应使环路面积尽可能小。
(23)每个集成电路一个解耦电容。在每一个电解电容器的边缘上都加有一个小型高频旁路电容器。
(24)采用大容量钽电容器或多晶硅电容器代替电解电容器作为电路充放电储能电容器。使用管状电容器时，外壳应接地。
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